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    3年以上候選人，設(shè)計(jì)崗要求有radio經(jīng)驗(yàn)；驗(yàn)證崗要求有systemverilog經(jīng)驗(yàn)，UVM用過了解即可。2年以內(nèi)候選人(應(yīng)屆生也可以)，懂FPGA即可，學(xué)歷要求碩士或者211/985以上。1. FPGA design Consultant Radio design ...
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    FPGA工程師

    12-24萬 | 成都市 | 本科 | 1-3年

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